计算机组成 P5 - Verilog Pipeline CPU
从P4的单周期CPU修改至流水线CPU，支持简单访存、计算、跳转、分支，指令：add, sub, ori, lui, beq, lw, sw, jal, jr, nop
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6 分钟
计算机组成 P4 - Verilog Single Cycle CPU
一个单周期的MIPS指令集CPU，支持指令：add, sub, ori, lw, sw, beq, lui, jal, jr, nop
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7 分钟